loykylewong /FPGA-Application-Development-and-Simulation
《FPGA应用开发和仿真》（机械工业出版社2018年第1版 ISBN:9787111582786）的源码。 Source Code of the book FPGA Application Development and Simulation(CHS).
Scala136
adpll 开源项目推荐（5 个）
adpll 话题在 GitHub 上没有填写简介，这里按 Star 数汇总最相关的热门仓库。
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GitHub 共 5 个仓库，已全部展示
anlit75 /ADPLL
全数字锁相环（ADPLL）
Verilog46
SriKondapaturi /tt-um-govardhana-adpll
Two-tile all-digital PLL taped out on TinyTapeout SKY26c (SkyWater 130nm). Ring-oscillator DCO, counter-based TDC, PI loop filter. Locks 10 MHz reference to programmable output frequency up to 63x.
Verilog1
vigneshsangaa /AI-ML-Based-Digital-Loop-Filter-for-ADPLL
An All-Digital PLL (UMC 180nm) with a 25th-order FIR digital loop filter whose coefficients are trained by an ANN — achieving 2.26 GHz output, 8 ns lock time, and 5.3 mW power.
Jupyter Notebook1
Pandiya2007 /Silicon_game_All-Digital-PLL-with-Vernier-TDC-SSCS-Chipathon-2026
All-Digital PLL with Vernier TDC — Silicon Game | SSCS Chipathon 2026
Tcl0
关于这个话题
- 清单取自 GitHub 话题页并按 Star 数排序，每次展示前 5 个项目；原始页面见 https://github.com/topics/adpll。
- 该话题在 GitHub 上共有 5 个仓库， 本站收录的是其中最热门的 5 个，不是全量列表。
- Star / Fork 每日自动刷新一次，实时数据以 GitHub 为准。
- 当前 5 个项目累计 184 Star，覆盖 4 种主要语言，数据更新于 2026-11-07。
- 中文介绍来自 GitHub 官方话题说明（github/explore）的机器翻译，可点「查看原文」对照；译文缺失时会先展示原文。